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verilog技术

Verilog实现74LS194芯片设计程序 Verilog作为一种种硬件描述语言目前已经得到了普遍运用。本文主要介绍了Verilog特点、Verilog用途以及Verilog实现74LS194芯片... 2017-12-22 标签:Verilog74LS194 144 0
Verilog/VHDL语法学习是掌握基本代码设计的技能以及经验总结 Verilog/VHDL语法学习是掌握基本代码设计的技能以及经验总结 无论是VHDL还是Verilog,建议初学者先掌握其中一门。 2017-12-19 标签:fpgavhdlverilog 1127 0
d触发器verilog描述 d触发器verilog描述 触发器是一个具有记忆功能的,具有两个稳定状态的信息存储器件,是构成多种时序电路的最基本逻辑单元,也是数字逻辑电路中一种重要的单元电路。在数字系统和计算机... 2017-12-12 标签:d触发器verilog 194 0
verilog实现定时器函数 使用Verilog描述硬件的基本设计单元是模块(module)。构建复杂的电子电路,主要是通过模块的相互连接调用来实现的。模块被包含在关键字module... 2017-12-08 标签:verilogc语言 187 0
基于Verilog的PS/2接口控制程序 基于Verilog的PS/2接口控制程序 通过Verilog编程实现在红色飓风II代Xilinx开发板上面实现对键盘、LCD、RS-232等接口或者器件进行控制,将有键盘输入的数据在LCD上面显... 2017-11-22 标签:verilogrs232 246 0
通过编写verilog代码实现OLED驱动和内容显示的解决方案 通过编写verilog代码实现OLED驱动和内容显示的解决方案 本实验通过verilog代码的编写,在EGO1开发板上实现OLED的驱动和内容显示。 2017-11-11 标签:VerilogOLEDOLED驱动 4720 0
改变数字硬件设计,实现真正工程化 改变数字硬件设计,实现真正工程化 与VHDL和Verilog一样,SpinalHDL可用于通过定义寄存器和门来描述硬件,SpinalHDL不使用众所周知的事件驱动范式来描述硬件(如VHD... 2017-08-10 标签:智能硬件数字电路verilog 823 3
基于Verilog FPGA 流水灯设计 基于Verilog FPGA 流水灯设计 流水广告灯主要应用于LED灯光控制。通过程序控制LED的亮和灭, 多个LED灯组成一个阵列,依次逐个点亮的时候像流水一样,所以叫流水灯。由于其形成美观大... 2017-08-09 标签:verilogfpga流水灯 1222 0
Verilog的语言要素 Verilog的语言要素 本章介绍Verilog HDL的基本要素,包括标识符、注释、数值、编译程序指令、系统任务和系统函数。另外,本章还介绍了Verilog硬件描述语言中的两种... 2017-02-11 标签:VerilogFPGA 350 0
Verilog HDL简明教程(2) Verilog HDL简明教程(2) 模块是Verilog 的基本描述单位,用于描述某个设计的功能或结构及其与其他模块通信的外部端口。 2017-02-11 标签:VerilogHDL 242 0
写verilog代码要有硬件的概念 写verilog代码要有硬件的概念 因为Verilog是一种硬件描述语言,所以在写Verilog语言时,首先要有所要写的module在硬件上如何实现的概念,而不是去想编译器如何去解释这个m... 2017-02-11 标签:verilogFPGA 462 0
初学者学习Verilog HDL的步骤和经验技巧 初学者学习Verilog HDL的步骤和经验技巧 Verilog HDL是一种硬件描述语言(HDL:Hardware Discription Language),Verilog HDL语言是一种以文本形... 2017-02-11 标签:VerilogHDLVHDL 4275 0
一个合格FPGA 工程师的基本要求 一个合格FPGA 工程师的基本要求 一个合格的FPGA工程师需要掌握哪些知识?这里根据自己的一些心得总结一下,其他朋友可以补充啊。 2017-02-11 标签:FPGAVerilog 759 0
FPGA开发与学习连载4 FPGA开发与学习连载4 Verilog中,用always块设计组合逻辑电路时,在赋值表达式右端参与赋值的所有信号都必须在always @(敏感电平列表)中列出,always中i... 2017-02-11 标签:FPGAVerilog 109 0
FPGA开发与学习连载:Verilog设计经验谈 FPGA开发与学习连载:Verilog设计经验谈 Verilog中,用always块设计组合逻辑电路时,在赋值表达式右端参与赋值的所有信号都必须在 always @(敏感电平列表)中列出,always中... 2017-02-11 标签:FPGAVerilog 153 0
Verilog的两个误区 Verilog的两个误区 Reg类 型只在过程块中被赋值;而Net类型则在过 程块外面被赋值或者驱动. 2017-02-11 标签:Verilog 184 0
用Verilog语言实现奇数倍分频电路3分频、5分频、7分频 9 用Verilog语言实现奇数倍分频电路3分频、5分频、7分频 9 分频器是FPGA设计中使用频率非常高的基本设计之一,尽管在目前大部分设计中,广泛使用芯片厂家集成的锁相环资源,如赛灵思(Xilinx)的DLL.来进行时... 2017-02-11 标签:Verilog分频电路 1444 0
Verilog设计中的一些避免犯错的小技巧 Verilog设计中的一些避免犯错的小技巧 这是一个在设计中常犯的错误列表,这些错误常使得你的设计不可靠或速度较慢,为了提高你的设计性能和提高速度的可靠性你必须确定你的设计通过所有的这些检查。 2017-02-11 标签:FPGAVerilog 89 0
赛灵思Verilog(FPGA/CPLD)设计技巧 赛灵思Verilog(FPGA/CPLD)设计技巧 以下是一个在设计中常犯的错误列表这些错误常使得你的设计不可靠或速度较慢为了提高你的设计性能和提高速度的可靠性你必须确定你的设计通过所有的这些检查 。 2017-02-11 标签:赛灵思VerilogFPGA 125 0
基于verilog的FPGA编程经验总结 基于verilog的FPGA编程经验总结 用了半个多月的ISE,几乎全是自学起来的,碰到了很多很多让人DT好久的小问题,百度也百不到,后来还是都解决了,为了尽量方便以后的刚学ISE的童鞋不再因为... 2017-02-11 标签:verilogFPGA 125 0

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